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Design of Cost-Efficient Interconnect Processing Units

Sprache EnglischEnglisch
Buch Hardcover
Buch Design of Cost-Efficient Interconnect Processing Units Lorenzo Pieralisi
Libristo-Code: 06681488
Verlag Taylor & Francis Inc, September 2008
Examines the technology that is set to replace well-known shared bus architectures, such as STBus, f... Vollständige Beschreibung
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Examines the technology that is set to replace well-known shared bus architectures, such as STBus, for demanding multiprocessor system-on-chip (SoC) applications. This book shows how the System-on-Chip and Network-on-Chip technology works why developers designed it the way they did the system-level design methodology.

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Informationen zum Buch

Vollständiger Name Design of Cost-Efficient Interconnect Processing Units
Autor Lorenzo Pieralisi
Sprache Englisch
Einband Buch - Hardcover
Datum der Veröffentlichung 2008
Anzahl der Seiten 288
EAN 9781420044713
ISBN 9781420044713
Libristo-Code 06681488
Verlag Taylor & Francis Inc
Gewicht 657
Abmessungen 156 x 234 x 25

Kategorie

Technologie, Ingenieurswissenschaft, Landwirtschaft, Industrieprozesse > Elektronik, Nachrichtentechnik > Elektronik > Schaltkreise und Komponenten (Bauteile)
Technologie, Ingenieurswissenschaft, Landwirtschaft, Industrieprozesse > Elektronik, Nachrichtentechnik > Elektronik > Elektronische Geräte und Materialien
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